| 术语 | logic_simulation |
| 释义 | logic simulation 逻辑模拟 使用电脑检查已设计出的逻辑线路是否有错的一种技术。可事先测试所设计的逻辑，从而保证逻辑设计的正确性。先将各逻辑元件的布林表示式、延迟时间及有关的时间资讯、暂存器的初始状态等资料送入电脑。机器对其进行分析与估值。从中判断所设计的逻辑线路是否可以实现预期的功能。通过模拟可把设计中存在的逻辑错误消除在组装之前。 |
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